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「化学機械研磨」の版間の差分

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'''化学機械研磨'''(かがくきかいけんま) または '''化学機械平坦化'''(かがくきかいへいたんか) は[[半導体]]製造における研磨技術のひとつ。英語名 (Chemical Mechanical Polishing)もしく(Chemical Mechanical Planarization) '''CMP'''略する。'''化学機械的研磨'''、'''化学的機械研磨'''とも表記される。研磨を強調したいときにPolishing、平坦にすることを強調するときに平坦化が用いられるが、一般には'''CMP'''の略語で表現することが多い。また、日本語として用いる場合に、化学機械平坦化の表現はほとんど現れないが、英語表記としては、少なくない
'''化学機械研磨'''(かがくきかいけんま)、英語名 (Chemical Mechanical Polishing) 、研磨液に含まれる化学成分の作用にって[[研磨剤]]研磨対象物の相対運動による機械的な研磨効果を増大させ、高速かつ平滑な研磨面を得る技術である。'''化学機械的研磨'''、'''化学的機械研磨'''とも表記される。
半導体大規模集積回路の集積度の向上(即ち、ひとつのチップに搭載されるトランジスタ数の増加)のためには、高密度化が必要である。ひとつのチップの占める面積を、ムーアの法則の進展速度で大きくすると、きわめて短時間に実際的な面積を超えてしまう。したがって、チップの中に配置するトランジスタのひとつあたりの寸法を小さくする必要がある。これが、[[ムーアの法則]]に従ったプロセスルールのスケーリングと呼ばれる現象である。
高密度化に対応するために水平方向の加工技術が大きく進化し、非常に微細な線幅の配線を製造できるようになったが、線幅の微細化を進めていくと、ある程度のところで垂直方向のずれ(即ち平坦度)が影響を及ぼすようになる。これは、[[フォトレジスト]](パターニング)の際の焦点距離と密接な関係がある。パターニングは、あらかじめ作成した原画をレジスト剤を塗布したシリコン基板の上に光学的に転写する工程である。
配線の間隔が小さくなって行くと、配線の間隔はやがて可視光の波長に近づいてくる。このため、転写の際の焦点距離の関係で明瞭な画像を作ることができる空間は、(2次元平面ではなく)3次元空間上である一定の範囲に限られる。明瞭な画像が得られる範囲から、基板の平面がずれてしまえば、いくら正確な転写装置を使っても、ボケた映像しか転写することができない、という問題がある。ボケた映像を使って配線を形成すれば、当然、配線の短絡や断線が生じることになり、製品の歩留まりや性能を著しく損ねることになる。
また、トランジスタの数が少ない間は必要ないが、ひとつのチップに搭載されるトランジスタの数が多くなると、トランジスタとトランジスタを結線して回路を構成するためには、ひとつの配線層では対応しきれなくなり、多数の配線層が必要になる。この多層化の際にも形状の誤差が生じると、上下の層間での結線不良を生じる。


 近年では、CPUを代表とする[[大規模集積回路]]の製造に用いるウェーハ表面の平坦化仕上げや、回路形成時の配線製造工程など、半導体製造工程全般で多用されるようになった研磨技術である([[半導体工学]]を参照のこと)。半導体製造工程においては、特に平坦な面を得ることが重要であるため、 平坦にすることを強調ために、'''化学機械平坦化'''(かがくきかいへいたんか) 英語名(Chemical Mechanical Planarization)とも表現する。いずれも略語は、'''CMP'''であり、実質的な相違はあまりない。
このように、CVDやPVDで形成した薄膜上に直接パターニンしてゆく従来の方法では対応ができなくなった。このような要求から、CVDやPVDによる薄膜形成の後に、表面を平坦化する技術が求められ、CMP技術が開発された。


 半導体大規模集積回路の集積度の向上(即ち、ひとつのチップに搭載されるトランジスタ数の増加)のためには、高密度化が必要である。ひとつのチップの占める面積を、ムーアの法則の進展速度で大きくすると、きわめて短時間に実際的な面積を超えてしまう。したがって、チップの中に配置するトランジスタのひとつあたりの寸法を小さくする必要がある。これが、[[ムーアの法則]]に従ったプロセスルールのスケーリングと呼ばれる現象である。
CMP技術は、従来の半導体ウェーハ(ベアウェーハ)の研磨設備を半導体集積回路の垂直方向の平坦化の目的で、生産工程の中間に取り入れたものである。
CMPが製造工程に取り入れられた当初は、LSIはアルミとシリコン酸化膜で製造されていたため、製造上の歩留まり向上に有効である先端LSIデバイス(CPUやASIC)などの一部分への応用に限られていたが、高クロック化に伴って配線間遅延が問題となり、銅ダマシンプロセスが利用されるようになってからは、不可欠なプロセスのひとつとなっている。


 高密度化に対応するために水平方向の加工技術が大きく進化し、非常に微細な線幅の配線を製造できるようになったが、線幅の微細化を進めていくと、ある程度のところで垂直方向のずれ(即ち平坦度)が影響を及ぼすようになる。これは、[[フォトリソグラフィ]](パターニング)の際の焦点距離と密接な関係がある。パターニングは、あらかじめ作成した原画をレジスト剤を塗布したシリコン基板の上に光学的に転写する工程である。
ウエハーの研磨量の制御や研磨に使われる研磨パッド、スラリーをはじめとした技術、装置の制御技術など、数多くの技術が今日までに改善されてきた。

 配線の間隔が小さくなって行くと、配線の間隔はやがて可視光の波長に近づいてくる。このため、転写の際の焦点距離の関係で明瞭な画像を作ることができる空間は、(2次元平面ではなく)3次元空間上である一定の範囲に限られる。明瞭な画像が得られる範囲から、基板の平面がずれてしまえば、いくら正確な転写装置を使っても、ボケた映像しか転写することができない、という問題がある。ボケた映像を使って配線を形成すれば、当然、配線の短絡や断線が生じることになり、製品の歩留まりや性能を著しく損ねることになる。

 また、トランジスタの数が少ない間は必要ないが、ひとつのチップに搭載されるトランジスタの数が多くなると、トランジスタとトランジスタを結線して回路を構成するためには、ひとつの配線層では対応しきれなくなり、多数の配線層が必要になる。この多層化の際にも形状の誤差が生じると、上下の層間での結線不良を生じる。

 このように、CVDやPVDで形成した薄膜上に直接パターニンしてゆく従来の方法では対応ができなくなった。このような要求から、CVDやPVDによる薄膜形成の後に、表面を平坦化する技術が求められ、CMP技術が開発された。

 CMP技術は、従来の半導体ウェーハ(ベアウェーハ)の研磨設備を半導体集積回路の垂直方向の平坦化の目的で、生産工程の中間に取り入れたものである。研磨時には発塵の可能性があるため、これを密閉し、かつ、ウェーハの搬出前に洗浄することで、研磨装置を半導体製造工程に不可欠な高クリーン度のクリーンルーム内に持ち込むことができるようになった
 CMPが製造工程に取り入れられた当初は、LSIはアルミとシリコン酸化膜で製造されていたため、製造上の歩留まり向上に有効である先端LSIデバイス(CPUやASIC)などの一部分への応用に限られていたが、高クロック化に伴って配線間遅延が問題となり、銅ダマシンプロセスが利用されるようになってからは、不可欠なプロセスのひとつとなっている。

 近年ではCMPの使用箇所は、

*シリコンウェーハそのもの(ベアウェーハ)の平坦化
*トランジスタ素子分離深溝(Shallow Trench Isoration)作成時
*タングステンプラグの埋め込み平坦化
*配線表面の平坦化

など、半導体製造工程のほとんどの段階に及んでいる。

 一般には、研磨対象物をキャリアと呼ばれる部材で保持し、研磨布または研磨パッドを張った平板(ラップ)に押し付けて、各種化学成分を含んだ研磨液と硬質の微細な研磨剤を含んだスラリーと一緒に相対運動させることで研磨を行う。化学成分が研磨対象物の表面を変化させることで、研磨剤単体で研磨する場合に比べて加工速度を向上することができる。また、研磨剤単体で研磨する場合に残る表面の微細な傷や表面付近に残る加工変質層がきわめて少なくなり、理想的な平滑面を得ることができる。

 研磨剤や研磨液は、研磨する対象物によって異なる。また、加工時に作用させる押し付け力や相対運動の速度も同時に加工品質に大きな影響を与える。CMPは前述のように、多種多様な箇所に用いられるため、それぞれに応じた適切組み合わせ(これをプロセスレシピと呼ぶ)が必要となる。

 半導体の生産性増大の要求から、ウェーハの直径は次第に大きくなってきているが、逆に配線幅が縮小しているために相対的に要求される加工精度は常に縮小し続けている。また、配線を形成する絶縁材料に新しい材料が次々と導入されつつある。このため、適切な加工性能を得るためのプロセスレシピも常に変化し続けており、特に配線表面の研磨に関しては激しい開発競争が行われている。

 ウエハーの研磨量の制御や研磨に使われる研磨パッド、スラリーをはじめとした技術、装置の制御技術など、数多くの技術が今日までに改善されてきた。

==関連項目==
*[[半導体工学]]
*[[研磨]]
*[[研磨剤]]


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2006年12月9日 (土) 05:48時点における版

化学機械研磨(かがくきかいけんま)、英語名 (Chemical Mechanical Polishing) は、研磨液に含まれる化学成分の作用によって、研磨剤と研磨対象物の相対運動による機械的な研磨効果を増大させ、高速かつ平滑な研磨面を得る技術である。化学機械的研磨化学的機械研磨とも表記される。

 近年では、CPUを代表とする大規模集積回路の製造に用いるウェーハ表面の平坦化仕上げや、回路形成時の配線製造工程など、半導体製造工程全般で多用されるようになった研磨技術である(半導体工学を参照のこと)。半導体製造工程においては、特に平坦な面を得ることが重要であるため、 平坦にすることを強調ために、化学機械平坦化(かがくきかいへいたんか) 英語名(Chemical Mechanical Planarization)とも表現する。いずれも略語は、CMPであり、実質的な相違はあまりない。

 半導体大規模集積回路の集積度の向上(即ち、ひとつのチップに搭載されるトランジスタ数の増加)のためには、高密度化が必要である。ひとつのチップの占める面積を、ムーアの法則の進展速度で大きくすると、きわめて短時間に実際的な面積を超えてしまう。したがって、チップの中に配置するトランジスタのひとつあたりの寸法を小さくする必要がある。これが、ムーアの法則に従ったプロセスルールのスケーリングと呼ばれる現象である。

 高密度化に対応するために水平方向の加工技術が大きく進化し、非常に微細な線幅の配線を製造できるようになったが、線幅の微細化を進めていくと、ある程度のところで垂直方向のずれ(即ち平坦度)が影響を及ぼすようになる。これは、フォトリソグラフィ(パターニング)の際の焦点距離と密接な関係がある。パターニングは、あらかじめ作成した原画をレジスト剤を塗布したシリコン基板の上に光学的に転写する工程である。

 配線の間隔が小さくなって行くと、配線の間隔はやがて可視光の波長に近づいてくる。このため、転写の際の焦点距離の関係で明瞭な画像を作ることができる空間は、(2次元平面ではなく)3次元空間上である一定の範囲に限られる。明瞭な画像が得られる範囲から、基板の平面がずれてしまえば、いくら正確な転写装置を使っても、ボケた映像しか転写することができない、という問題がある。ボケた映像を使って配線を形成すれば、当然、配線の短絡や断線が生じることになり、製品の歩留まりや性能を著しく損ねることになる。

 また、トランジスタの数が少ない間は必要ないが、ひとつのチップに搭載されるトランジスタの数が多くなると、トランジスタとトランジスタを結線して回路を構成するためには、ひとつの配線層では対応しきれなくなり、多数の配線層が必要になる。この多層化の際にも形状の誤差が生じると、上下の層間での結線不良を生じる。

 このように、CVDやPVDで形成した薄膜上に直接パターニンしてゆく従来の方法では対応ができなくなった。このような要求から、CVDやPVDによる薄膜形成の後に、表面を平坦化する技術が求められ、CMP技術が開発された。

 CMP技術は、従来の半導体ウェーハ(ベアウェーハ)の研磨設備を半導体集積回路の垂直方向の平坦化の目的で、生産工程の中間に取り入れたものである。研磨時には発塵の可能性があるため、これを密閉し、かつ、ウェーハの搬出前に洗浄することで、研磨装置を半導体製造工程に不可欠な高クリーン度のクリーンルーム内に持ち込むことができるようになった。  CMPが製造工程に取り入れられた当初は、LSIはアルミとシリコン酸化膜で製造されていたため、製造上の歩留まり向上に有効である先端LSIデバイス(CPUやASIC)などの一部分への応用に限られていたが、高クロック化に伴って配線間遅延が問題となり、銅ダマシンプロセスが利用されるようになってからは、不可欠なプロセスのひとつとなっている。

 近年ではCMPの使用箇所は、

  • シリコンウェーハそのもの(ベアウェーハ)の平坦化
  • トランジスタ素子分離深溝(Shallow Trench Isoration)作成時
  • タングステンプラグの埋め込み平坦化
  • 配線表面の平坦化

など、半導体製造工程のほとんどの段階に及んでいる。

 一般には、研磨対象物をキャリアと呼ばれる部材で保持し、研磨布または研磨パッドを張った平板(ラップ)に押し付けて、各種化学成分を含んだ研磨液と硬質の微細な研磨剤を含んだスラリーと一緒に相対運動させることで研磨を行う。化学成分が研磨対象物の表面を変化させることで、研磨剤単体で研磨する場合に比べて加工速度を向上することができる。また、研磨剤単体で研磨する場合に残る表面の微細な傷や表面付近に残る加工変質層がきわめて少なくなり、理想的な平滑面を得ることができる。

 研磨剤や研磨液は、研磨する対象物によって異なる。また、加工時に作用させる押し付け力や相対運動の速度も同時に加工品質に大きな影響を与える。CMPは前述のように、多種多様な箇所に用いられるため、それぞれに応じた適切組み合わせ(これをプロセスレシピと呼ぶ)が必要となる。

 半導体の生産性増大の要求から、ウェーハの直径は次第に大きくなってきているが、逆に配線幅が縮小しているために相対的に要求される加工精度は常に縮小し続けている。また、配線を形成する絶縁材料に新しい材料が次々と導入されつつある。このため、適切な加工性能を得るためのプロセスレシピも常に変化し続けており、特に配線表面の研磨に関しては激しい開発競争が行われている。

 ウエハーの研磨量の制御や研磨に使われる研磨パッド、スラリーをはじめとした技術、装置の制御技術など、数多くの技術が今日までに改善されてきた。

関連項目