ファイル:5 Stage Pipeline.svg
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元のファイル (SVG ファイル、300 × 190 ピクセル、ファイルサイズ: 33キロバイト)
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| 解説 |
English: A diagram showing the stage of execution reached by five consecutive instructions in a 5-stage microprocessor. At clock cycle 4, the 1st instruction is in the "memory access" phase, the second is in the "execute" phase, the third in the "instruction decode" phase, the fourth in the "instruction fetch" phase and the fifth hasn't been fetched yet. |
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| 日付 | |||
| 原典 | 投稿者自身による著作物 | ||
| 作者 | Inductiveload | ||
| 許可 (ファイルの再利用) |
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| 日付と時刻 | サムネイル | 寸法 | 利用者 | コメント | |
|---|---|---|---|---|---|
| 現在の版 | 2009年1月22日 (木) 18:24 | | 300 × 190 (33キロバイト) | Inductiveload | {{Information |Description={{en|1=A diagram showing the stage of execution reached by five consecutive instructions in a 5-stage microprocessor. At clock cycle 4, the 1st instruction is in the "memory access" phase, the second is in the "execute" phase, t |
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